互補(bǔ)金屬氧化物半導(dǎo)體感光芯片(CMOS Image Sensor, CIS)是消費(fèi)電子、工業(yè)影像設(shè)備的核心半導(dǎo)體元器件。芯片表面平面度(Flatness)是封裝工藝與成像品質(zhì)的核心質(zhì)控指標(biāo),依據(jù)GB/T 39560-2020半導(dǎo)體芯片翹曲度測(cè)試標(biāo)準(zhǔn)及行業(yè)量產(chǎn)規(guī)范,高端CIS芯片平面度誤差管控閾值≤5 μm。在微型化、高密度板上芯片封裝(Chip On Board, COB)工藝場(chǎng)景下,芯片微小翹曲、表面凹凸形變,會(huì)引發(fā)封裝貼合偏移、光學(xué)對(duì)焦不準(zhǔn)、成像景深不均等問題,直接降低產(chǎn)品良率與長(zhǎng)期使用可靠性,因此高精度平面度檢測(cè)為量產(chǎn)必備工序。



傳統(tǒng)接觸式測(cè)高儀、二維光學(xué)檢測(cè)設(shè)備存在檢測(cè)景深有限、微米級(jí)精度不足、探針易劃傷芯片光敏面等弊端,無法適配高精度CIS芯片質(zhì)控需求。光學(xué)3D輪廓儀(3D Optical Profiler)依托白光干涉(White Light Interferometry)與結(jié)構(gòu)光三維掃描技術(shù),實(shí)現(xiàn)非接觸式全域形貌檢測(cè)。依據(jù)設(shè)備廠商公開技術(shù)參數(shù),該設(shè)備Z軸重復(fù)測(cè)量精度可達(dá)0.3–0.4 μm,可精準(zhǔn)采集芯片全局平面度偏差與微觀形變數(shù)據(jù),完整還原芯片三維表面形貌,符合SEMI M73晶圓平面度測(cè)量行業(yè)規(guī)范。




相較于傳統(tǒng)檢測(cè)方案,光學(xué)3D輪廓測(cè)量方案無接觸損傷風(fēng)險(xiǎn),兼顧微米級(jí)檢測(cè)精度與量產(chǎn)檢測(cè)效率,可全覆蓋CIS芯片貼片、封裝、終檢全生產(chǎn)工序。該方案可有效規(guī)避平面度不良引發(fā)的封裝失效、成像失真等質(zhì)量問題,契合高端影像芯片精密制造的質(zhì)控要求,是當(dāng)前半導(dǎo)體影像元器件量產(chǎn)的主流精準(zhǔn)測(cè)量方案(Precision Measurement Scheme)。



新啟航半導(dǎo)體|專業(yè)白光干涉 3D 輪廓測(cè)量方案。亞納米精度保障,支持自動(dòng)化定制;高端系列對(duì)標(biāo)國(guó)際一線品牌,大視野設(shè)計(jì),輕松應(yīng)對(duì)高低反射、復(fù)雜材料測(cè)量場(chǎng)景。
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